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很多工程师画板子时，层数是根据"走线能不能走完"来决定的——4层走不完就加到6层，6层不够就8层。但层叠设计远不止"够不够走线"这么简单，它直接决定了信号完整性、EMC性能、电源完整性和PCB成本。层叠规划得好，板子性能稳、EMC容易过；规划得不好，后期怎么改都头疼。

层叠设计的核心原则

常见层叠方案

Top（信号）    —— 走顶层关键信号 GND（地）     —— 完整地平面 PWR（电源）   —— 电源平面 Bottom（信号） —— 走剩余信号

• 优点：成本低，结构简单，有完整地平面和电源平面
• 缺点：只有两个信号层，走线密度有限；电源和地之间介质较厚（约1.0mm），去耦电容小
• 适用：中等复杂度电路，有少量高速信号

Top（信号） GND（地） PWR（电源） Bottom（信号）

Top（信号）      —— 关键高速信号 GND1（地）      —— 完整地平面 Signal1（信号）  —— 剩余信号 Signal2（信号）  —— 剩余信号 PWR（电源）     —— 电源平面 Bottom（信号）   —— 低频信号/电源走线

• 优点：4个信号层，走线充裕；有完整地平面；电源和地间距可以做得较小
• 缺点：中间两个信号层（Signal1/Signal2）相邻，容易产生串扰
• 适用：复杂数字电路、FPGA、多电源系统

Top（信号） GND1（地） Signal（信号） PWR（电源） GND2（地） Bottom（信号）

Top（信号）      —— 关键高速信号 GND1（地）      —— 完整地平面 Signal1（信号）  —— 高速信号 PWR1（电源）    —— 核心电源 PWR2（电源）    —— IO电源/辅助电源 GND2（地）      —— 完整地平面 Signal2（信号）  —— 低频信号 Bottom（信号）   —— 低频信号/调试信号

• 优点：6个信号层，走线非常充裕；两个地平面+两个电源平面，电源完整性好；关键信号层都有相邻地平面
• 缺点：成本较高，压合工艺复杂
• 适用：高端FPGA、高速背板、服务器主板、复杂SoC系统

层叠设计的常见错误

• 成本上升（每加2层成本增加30-50%）
• 压合难度增加，良率下降
• 板厚不变时，层间介质变薄，阻抗控制难度增加

打样阶段怎么选层数

• 走线密度不高、无高速信号：2层或4层
• 有高速信号（DDR、PCIe、以太网）：至少4层，建议6层
• FPGA/SoC引脚多、电源网络复杂：6层或8层
• EMC要求严格（汽车电子、医疗）：优先选有完整地平面和电源平面的层叠方案